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https://www.reddit.com/r/FPGA/comments/12mg5su/having_issues_writing_data_from_fpga_to_hps_using/?tl=fr
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*fpga
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library ieee;
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use ieee.std_logic_1164.all;
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entity fpga_dma_rgb32_simple is
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  port (
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    clk  : in  std_logic;
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    reset : in  std_logic;
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    -- Avalon-MM master
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    avm_address    : out std_logic_vector(31 downto 0);
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    avm_write      : out std_logic;
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    avm_writedata  : out std_logic_vector(31 downto 0);
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    avm_waitrequest : in  std_logic
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end entity;
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architecture rtl of fpga_dma_rgb32_simple is
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  constant BASE_ADDR    : unsigned(31 downto 0) := x"3FB00000";
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  constant WIDTH        : integer := 640;
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  constant HEIGHT      : integer := 480;
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  constant TOTAL_PIXELS : integer := WIDTH * HEIGHT; -- 307200
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  signal pixel_index : integer range 0 to TOTAL_PIXELS-1 := 0;
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  signal addr        : unsigned(31 downto 0);
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  signal write_reg  : std_logic := '0';
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  -- Pattern RGB32 (XRGB8888)
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  signal r, g, b    : unsigned(7 downto 0);
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  signal pixel32    : unsigned(31 downto 0);
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begin
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  -- Générateur simple de pattern
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  r <= to_unsigned((pixel_index mod WIDTH) * 255 / WIDTH, 8);
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  g <= to_unsigned((pixel_index / WIDTH) * 255 / HEIGHT, 8);
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  b <= to_unsigned(128, 8);
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--  pixel32 <= x"00" & r & g & b;  -- XRGB8888
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  pixel32 <= x"AAAAAAAA";  -- XRGB8888
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  avm_writedata <= std_logic_vector(pixel32);
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  -- Adresse courante
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  addr <= BASE_ADDR + to_unsigned(pixel_index * 4, 32);
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  avm_address <= std_logic_vector(addr);
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  avm_write  <= write_reg;
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  -- FSM simple
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  process(clk)
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  begin
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    if rising_edge(clk) then
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        if avm_waitrequest = '0' then
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          write_reg <= '1';
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          pixel_index <= pixel_index + 1;
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          -- boucle image
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          if pixel_index = TOTAL_PIXELS-1 then
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            pixel_index <= 0;
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          end if;
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        else
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          write_reg <= '0';
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        end if;
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    end if;
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  end process;
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end architecture;
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***0x01 = Fast mode (400 kHz)
 
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*broches
 
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**su le connecteur LTC
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**sur le connecteur LTC
 
**ATTENTION : il faut mettre des résistances de Pull-Up !!!
 
**ATTENTION : il faut mettre des résistances de Pull-Up !!!

Version actuelle datée du 2 février 2026 à 12:00

Ecriture dans la DDR

!!! ATTENTION : le bus avalon ne peut pas accéder à tout l'espace de la DDR
à vérifier mais ne marche pas à l'@ 0x3f000000
utiliser une zone mémoire à l'@ 0x30000000

il faut autoriser l'accès avec :
memtool mw -l 0xFFC25080 0x1F0


// a supprimer

  • dans uboot
mw 0xFFC25080 0x1F0
mw 0xFFC2505C 0xA
  • sur linux
memtool mw -l 0xFFC25080 0x1F0
memtool mw -l 0xFFC2505C 0xA


https://www.reddit.com/r/FPGA/comments/12mg5su/having_issues_writing_data_from_fpga_to_hps_using/?tl=fr

https://people.ece.cornell.edu/land/courses/ece5760/DE1_SOC/cv_5_HPS_tech_ref.pdf

  • fpga
library ieee;
use ieee.std_logic_1164.all;
use ieee.numeric_std.all;

entity fpga_dma_rgb32_simple is
  port (
    clk   : in  std_logic;
    reset : in  std_logic;

    -- Avalon-MM master
    avm_address     : out std_logic_vector(31 downto 0);
    avm_write       : out std_logic;
    avm_writedata   : out std_logic_vector(31 downto 0);
    avm_waitrequest : in  std_logic
  );
end entity;

architecture rtl of fpga_dma_rgb32_simple is

  constant BASE_ADDR    : unsigned(31 downto 0) := x"3FB00000";
  constant WIDTH        : integer := 640;
  constant HEIGHT       : integer := 480;
  constant TOTAL_PIXELS : integer := WIDTH * HEIGHT; -- 307200

  signal pixel_index : integer range 0 to TOTAL_PIXELS-1 := 0;
  signal addr        : unsigned(31 downto 0);
  signal write_reg   : std_logic := '0';

  -- Pattern RGB32 (XRGB8888)
  signal r, g, b    : unsigned(7 downto 0);
  signal pixel32    : unsigned(31 downto 0);

begin

  --------------------------------------------------------------------
  -- Générateur simple de pattern
  --------------------------------------------------------------------
  r <= to_unsigned((pixel_index mod WIDTH) * 255 / WIDTH, 8);
  g <= to_unsigned((pixel_index / WIDTH) * 255 / HEIGHT, 8);
  b <= to_unsigned(128, 8);

--  pixel32 <= x"00" & r & g & b;  -- XRGB8888
  pixel32 <= x"AAAAAAAA";  -- XRGB8888

  avm_writedata <= std_logic_vector(pixel32);

  --------------------------------------------------------------------
  -- Adresse courante
  --------------------------------------------------------------------
  addr <= BASE_ADDR + to_unsigned(pixel_index * 4, 32);

  avm_address <= std_logic_vector(addr);
  avm_write   <= write_reg;
  --------------------------------------------------------------------
  -- FSM simple
  --------------------------------------------------------------------
  process(clk)
  begin
    if rising_edge(clk) then
        if avm_waitrequest = '0' then
          write_reg <= '1';

          pixel_index <= pixel_index + 1;

          -- boucle image
          if pixel_index = TOTAL_PIXELS-1 then
            pixel_index <= 0;
          end if;
        else
          write_reg <= '0';
        end if;
    end if;
  end process;

end architecture;

I2C

Media:DE0-Nano-SoC_Schematic.pdf

  • on utilisera le bus i2c1
  • la vitesse est de 100kHz
    • dans le fichier device-tree
    • modifier speed-mode = <0x00>
      • 0x00 = Standard mode (100 kHz)
      • 0x01 = Fast mode (400 kHz)
  • broches
    • sur le connecteur LTC
    • ATTENTION : il faut mettre des résistances de Pull-Up !!!
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